電路IC設(shè)計工作經(jīng)驗簡歷模板

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　　主要職責(zé)：

　　2002/07—至今：哈工大

　　所屬行業(yè)：電子技術(shù)/半導(dǎo)體/集成電路

　　集成電路設(shè)計 集成電路IC設(shè)計/應(yīng)用工程師

　　在校期間以碩士生身份獲得深圳“非共識創(chuàng)新基金”資助(學(xué)生創(chuàng)業(yè)計劃，獲得該項資助的多為博士生)

　　工作業(yè)績：扎實的C語言功底,了解匯編=語言，熟悉Gcc 熟悉Verilog

　　HDL語言，了解VHDL、C++、Tcl及Perl語言熟悉Linux系統(tǒng)，熟練掌握vi、gcc、ncverilog及Modelsim的使用扎實的專業(yè)基礎(chǔ)，對數(shù)字電路、模擬電路及器件結(jié)構(gòu)原理都有深刻的理解和掌握熟悉數(shù)字集成電路的設(shè)計與驗證Top-down流程掌握Design

　　Compiler及icfb等EDA工具的使用…………。

　　項目經(jīng)驗

　　2007/05—至今： 指紋識別芯片開發(fā)

　　軟件環(huán)境：linux

　　開發(fā)工具：Gcc, Nc-verilog, Design Compiler

　　項目描述：開發(fā)一款指紋識別芯片，主要用于汽車門禁。芯片功能包括對指紋圖像的預(yù)處理及與指紋庫中圖像進行匹配兩部分

　　…………。

　　2006/10—2007/05： 打印機墨盒芯片設(shè)計

　　軟件環(huán)境：Cadence

　　項目描述：開發(fā)一款用于打印機墨盒上的芯片，市場上的墨盒芯片一般是專用的，一家公司有自己單獨的芯片，互不兼容，本項目旨在開發(fā)一款兼容性的芯片

　　責(zé)任描述：芯片電路設(shè)計

　　2005/10—2006/07： Secure Digital(SD) 主機接口驗證

　　軟件環(huán)境：unix

　　開發(fā)工具：Verilog-XL, Debussy,Design Compiler

　　項目描述：對SD接口程序的HDL代碼進行功能驗證及綜合

　　責(zé)任描述：分析SD主機接口Verilog

　　HDL源代碼，編寫測試程序，用Verilog-XL完成功能驗證;用DC對修改后的代碼綜合;撰寫相關(guān)的技術(shù)文檔。

　　教育培訓(xùn)

　　…………

　　職業(yè)技能

　　外 語： 英語：熟練

　　計 算 機： Adobe Photoshop 一般 15月

　　Perl 了解 3月

　　C/C++ 精通 30月

　　C/C++ 熟練 50月

　　證 書： 2005/04全國計算機等級三級A 上機優(yōu)秀，筆試良好

　　2004/06大學(xué)英語六級 68/100

　　2004/01大學(xué)英語四級 84/100

　　自我評價

　　扎實的專業(yè)基礎(chǔ)知識，對CMOS器件結(jié)構(gòu)及原理有深刻的認(rèn)識，對IC設(shè)計前后端都有較深刻的認(rèn)識，勤于思考，有較強的邏輯思維及快速學(xué)習(xí)能力，善于接納和應(yīng)用新理論，良好的溝通能力及團隊意識，有上進心及創(chuàng)新意識，踏實，能吃苦。
 

 

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